混疊所有的模擬數字轉換器以每隔一定時間進行采樣的形式進行工作。因此，它們的輸出信號只是對輸入信號行為的不完全描述。在某一次采樣和下一次采樣之間的時間段，**根據輸出信號，是無法得知輸入信號的形式的。如果輸入信號以比采樣率低的速率變化，那么可以假定這兩次采樣之間的信號介于這兩次采樣得到的信號值。然而，如果輸入信號改變過快，則這樣的假設是錯誤的。如果模擬數字轉換器產生的信號在系統的后期，通過數字模擬轉換器，則輸出信號可以忠實地反映原始信號。如經過輸入信號的變化率比采樣率大得多，則是另一種情況，模擬數字轉換器輸出的這種“假”信號被稱作“混疊”。混疊信號的頻率為信號頻率和采樣率的差。例如，一個2千赫茲的正弦曲線信號在采樣率在1.5千赫茲采樣率的轉換后，會被重建為500赫茲的正弦曲線信號。這樣的問題被稱作“混疊”。模擬信號在時域上是連續的，因此可以將它轉換為時間上連續的一系列數字信號。靜安區通用數模轉換器私人定做

可以采集連續變化、帶寬受限的信號（即每隔一時間測量并存儲一個信號值），然后可以通過插值將轉換后的離散信號還原為原始信號。這一過程的精確度受量化誤差的限制。然而，*當采樣率比信號頻率的兩倍還高的情況下才可能達到對原始信號的忠實還原，這一規律在采樣定理有所體現。由于實際使用的模擬數字轉換器不能進行完全實時的轉換，所以對輸入信號進行一次轉換的過程中必須通過一些外加方法使之保持恒定。常用的有采樣-保持電路，在大多數的情況里，通過使用一個電容器可以存儲輸入的模擬電壓，并通過開關或門電路來閉合、斷開這個電容和輸入信號的連接。許多模擬數字轉換集成電路在內部就已經包含了這樣的采樣-保持子系統。楊浦區通用數模轉換器推薦貨源D/A轉換器基本上由4個部分組成，即權電阻網絡、運算放大器、基準電源和模擬開關。

D/A轉換器由數碼寄存器、模擬電子開關電路、解碼網絡、求和電路及基準電壓幾部分組成。數字量以串行或并行方式輸入、存儲于數碼寄存器中，數字寄存器輸出的各位數碼，分別控制對應位的模擬電子開關，使數碼為1的位在位權網絡上產生與其權值成正比的電流值，再由求和電路將各種權值相加，即得到數字量對應的模擬量。按解碼網絡結構不同T型電阻網絡D/A轉換器相關示圖倒T型電阻網絡D/A轉換器權電流D/A轉換器權電阻網絡D/A轉換器按模擬電子開關電路的不同CMOS開關型D/A轉換器（速度要求不高）雙極型開關D/A轉換器 電流開關型（速度要求較高）ECL電流開關型（轉換速度更高）

數字量是用代碼按數位組合起來表示的，對于有權碼，每位代碼都有一定的位權。為了將數字量轉換成模擬量，必須將每1位的代碼按其位權的大小轉換成相應的模擬量，然后將這些模擬量相加，即可得到與數字量成正比的總模擬量，從而實現了數字—模擬轉換。這就是組成D/A轉換器的基本指導思想。圖11.1.1表示了4位二進制數字量與經過D/A轉換后輸出的電壓模擬量之間的對應關系。 由圖11.1.1還可看出，兩個相鄰數碼轉換出的電壓值是不連續的，兩者的電壓差由比較低碼位**的位權值決定。它是信息所能分辨的**小量，也就是我們所說的用1LSB(Least Significant Bit)表示。對應于比較大輸入數字量的最大電壓輸出值（***值），用FSR(Full Scale Range)表示數字信號先進行解碼，即把數字碼轉換成與之對應的電平，形成階梯狀信號，然后進行低通濾波。

間接ADC是先將輸入模擬電壓轉換成時間或頻率，然后再把這些中間量轉換成數字量，常用的有中間量是時間的雙積分型ADC [5]。并聯比較型ADC：由于并聯比較型ADC采用各量級同時并行比較，各位輸出碼也是同時并行產生，所以轉換速度快是它的突出優點，同時轉換速度與輸出碼位的多少無關。并聯比較型ADC的缺點是成本高、功耗大。因為n位輸出的ADC，需要2n個電阻，（2n－1）個比較器和D觸發器，以及復雜的編碼網絡，其元件數量隨位數的增加，以幾何級數上升。所以這種ADC適用于要求高速、低分辯率的場合 [5]。在實際使用中，表示分辨率大小的方法也用輸入數字量的位數來表示。浦東新區加工數模轉換器推薦貨源

失調誤差(或稱零點誤差)定義為數字輸入全為0碼時，其模擬輸出值與理想輸出值之偏差值。靜安區通用數模轉換器私人定做

輸入時其輸出值與理想輸出值(滿量程)之間的偏差表示，一般也用LSB的份數或用偏差值相對滿量程的百分數來表示。非線性誤差D/A轉換器的非線性誤差定義為實際轉換特性曲線與理想特性曲線之間的比較大偏差，并以該偏差相對于滿量程的百分數度量。在轉換器電路設計中，一般要求非線性誤差不大于±1/2LSB。并行數模轉換數模轉換有兩種轉換方式：并行數模轉換和串行數模轉換。圖1為典型的并行數模轉換器的結構。虛線框內的數碼操作開關和電阻網絡是基本部件。靜安區通用數模轉換器私人定做

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